并将每一段独有的抽离后的模块包文件发送至web微服务平台化的前端开发框架,以生成对应的前端模块;配置定义单元,用于对所述前端应用模块所属的前端模块进行定义,其中,所述定义包括对所述前端模块的静态资源目录和工程化相关文件进行的配置;依赖建立单元,用于通过javascript包管理工具建立所述定义后的前端模块的依赖关系;环境搭建单元,用于从所述web微服务平台化的前端开发框架中预建立的工程模板中获取待搭建环境的待用模板,根据待用模板以及所述依赖关系搭建前端开发环境。上述的装置,所述装置还包括:读取模块,用于读取web微服务平台化的前端开发框架的配置文件以获取定义后的前端模块;管理模块,用于对所述定义后的前端模块进行预编译、打包和压缩,并将压缩后的前端模块发送至包管理工具进行管理。第三方面,本发明还提供了一种电子设备,所述电子设备包括:处理器;用于存储处理器可执行的指令的存储器;其中,所述存储器被配置为用以实施上述的前端开发环境的搭建方法。第四方面,本发明还提供了一种非易失性计算机可读存储介质,其上存储有计算机程序指令,所述计算机程序指令被处理器执行时实现上述任意一项所述的前端开发环境的搭建方法。无锡邦程信息科技有限公司,专业的帮助客户在新的全球化互联网环境中保持优势。江苏什么是技术搭建市场价
所述第二依赖关系可以为在新增前端模块的web微服务环境中前端模块与对应的组件或对应应用之间的通信协议产生,所述一依赖关系与所述第二依赖关系之间可以互为补充,亦可为互为包含,通过根据所述一依赖关系和所述第二依赖关系生成所述定义后的前端模块的依赖关系,能够避免封装后的前端模块在配置时出现依赖偏差。本发明实施例的前端开发环境搭建完成后,通过读取平台配置文件获取所需要的client模块,按照配置文件中的顺序依次加载对应的各模块,然后获取到各模块的静态资源路径,将该路径通过执行,这样就实现了结合上述依赖关系控制client模块的静态资源加载及相应顺序。在平台与client模块开发过程中,还可以通过npmlink命令实现开发的工程组下内部模块协同开发的问题,防止频繁的发布和装载。通过本发明实施例搭建的前端开发环境,可以让前端人员友好的控制及调试开发,不依赖任何后端服务、数据库和中间件。本发明实施例一种可行的实施方式中,平台提供的client模块的模板可内置多种命令完善前端工程化的结构标准、代码规范,例如editorconfig:同化编辑器之前差异;eslint:模块包文件所表示的代码校验;prettier:美化代码等。本发明实施例一种可行的实施方式中。江苏什么是技术搭建市场价无锡邦程信息科技有限公司,向广大用户提供好质量产品和好质量服务,从而赢得了用户的信赖。
以获得时间和日期等。异步传输是按字符传输的,一个字符的信息由起始位、数据位、奇偶校验位和停止位组成,1位起始位、8位数据位、2位停止位和无校验位异步数据帧格式见图2所示。通过检测输入数据的下降沿获得起始位,按波特率生成接收时钟,采集串行输入数据并移位操作。判断标志信息,提取数据位数据,进行串转并处理,获得时间信息和有效/无效状态信息,并将两者的信息转换成相对应的年月日时分秒的时间信息以便比对。图2异步通信的帧格式有线时基信号的获取:IRIG-B码是一种常用的授时方式,含有时间信息和准确的脉冲沿信息。输出是一种串行时间码,帧长1S,共计100个码元,码元宽度为10ms,采用脉宽编码形式,2ms脉宽表示“0”、5ms脉宽表示“1”、8ms脉宽表示“P”,格式见图3所示。图3一帧B码示意波形图采用10KHz时钟信号对B码的输入信号进行计数处理,设定误差范围(如±5个单位相当于),识别“0”、“1”、“P”码,获得时分秒、天数和年数据,并转换成相对应的年月日时分秒的时间信息以便比对。IRIG-B脉冲信号的获取:连续出现2个P标志位是IRIG-B码准确的帧头,其中第2个标志位的前沿与秒脉冲信号同步。
在PR码头前1ms输出秒控制信号B与IRIG-B码的信号A进行与运算,输出的C信号即为解调出来的同步秒脉冲信号,确保了秒脉冲前沿的精度,见图4所示。图4IRIG-B解调秒脉冲的形成基准信号的比对:分别对时间信息和秒脉冲信息进行比对。在时间数据比较相同时认为时间信息一致,而脉冲前沿在允许的误差范围内(如±µS)认为一致。基准信息的选择:系统通过参数设置健设置基准时间输入的优先级,通常按BD-GPS-IRIG-B设置优先级,也可以按GPS-BD-IRIG-B设置优先级等。当三个或两个时基源比对结果完全一致时,选择结果一致的时基源优先级比较高的冗余时间信号和脉冲信号输出,当比对结果不一致时不进行时间同步。选择冗余输出的时间信息同步内部时间(需要进行加1秒处理),脉冲信号同步分频电路和全局时间。输出信号的处理经同步驯服的频率信号在FPGA内部分频计数,输出标准的1PPS、1PPM和1PPH信号。将参考码元、识别标志、秒、分、时、天、年和当天的总秒数,按图3所示的时序格式编码,进行并转串处理,数据输出选择响应的计数脉宽输出,参考码元和识别标志选择8ms的脉宽输出,数据“0”和“1”分别选择2ms和5ms的脉宽输出,由此获得IRIG-B直流码信号。IRIG-B直流码信号经正弦调制。无锡邦程信息科技有限公司专业从事网站建设、电商方及APP开发等业务。
通过在前端模块接入web微服务平台化的前端开发框架的入口文件中增加相应的申明(以定义的方式或修改属性参数的方式进行)的方式,使得前端模块在,因此通过搭建企业内部的npm仓库,将前端模块的各client模块通过npmpublish发布至搭建的新的前端开发环境,达到所有的client前端模块进行管理的效果。本发明实施例一种可行的实施方式中,所述通过所述包管理工具建立所述定义后的前端模块的依赖关系,包括:在步骤410中,获取所述前端模块的应用模块与组件间的一依赖关系;所述一依赖关系为所述模块包文件(具体为业务子模块)在工程中所体现的应用模块与组件之间的依赖关系,其一般可通过资源映射的方式体现,所述一依赖关系一般为原web微服务环境中模块包文件与web微服务之间的通信协议产生的,亦可通过调取资源映射文件的方式调取。在步骤420中,工程化相关文件获取所述前端模块的平台模块与应用模块间的第二依赖关系;在步骤430中,根据所述一依赖关系和所述第二依赖关系生成所述定义后的前端模块的依赖关系。所述第二依赖关系为模块包文件具体为平台业务模块与对应的应用模块之间的对应关系,其一般地可在封装的配置文件中体现。邦程一直秉承专业、诚信、服务、进取的价值观,坚持互联网品牌设计经验和整合营销的理念。江西营销技术搭建信息中心
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提供高精度、稳定的频率信号,经外部时基信号同步,形成内部时钟,实现时间的同步和统一。同步时间输出的选择电力系统自动化设备种类繁多,对时间同步的要求也各种各样。FPGA的实时性和多输入输出端口,使得实现多种时间信号输出成为可能。目前时间同步信号主要包含为:脉冲校时(秒脉冲、分脉冲和时脉冲)、串口校时、交直流IRIG-B码校时、NTP或PTP网络校时,以及光纤接口校时等。3基于FPGA系统方案的实现根据变电站对时间同步的要求,选择FPGA为中心,实现多时钟源输入和多授时方式输出接口的时钟装置,系统组成原理框图如图1所示。图1时间同步系统组成同步信号的处理时钟系统的时间同步信号主要来自外部时钟源,对外部时钟源发送的数据和脉冲信号进行处理,获得时间信息和准时间沿信息,通过解调出的时间信息校正系统内的时分秒和日期,并对解调出的准确时间沿脉冲(通常是秒脉冲信号)同步系统的脉冲输出及各输出信息的发送时刻。空基时基信号的获取:将GPS和BD的NMEA0183[1][2]输出语句统一设置为4800波特率、异步传输方式,经转换为TTL电平输入到FPGA。GPS的输出语句选择$GPZDA,,,*hh语句;BD的输出语句选择$CPZDA,,,,,,*hh,通过对该语句按格式译码。江苏什么是技术搭建市场价
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