企业商机
数字信号测试基本参数
  • 品牌
  • 克劳德
  • 型号
  • 数字信号测试
数字信号测试企业商机

采用前向时钟的总线因为有专门的时钟通路,不需要再对数据进行编解码,所以总线效率一般都比较高。还有一个优点是线路噪声和抖动对于时钟和数据线的影响基本是一样的(因为走线通常都在一起),所以对系统的影响可以消除到小。

嵌入式时钟的电路对于线路上的高频抖动非常敏感,而采用前向时钟的电路对高频抖动的敏感度就相对小得多。前向时钟总线典型的数据速率在500Mbps~12Gbps.

在前向时钟的拓扑总线中,时钟速率通常是数据速率的一半(也有采用1/4速率、1/10或其他速率的),数据在上下边沿都采样,也就是通常所说的DDR方式。使用DDR采样的好处是时钟线和数据线在设计上需要的带宽是一样的,任何设计上的局限性(比如传输线的衰减特性)对于时钟和数据线的影响是一样的。

前向时钟在一些关注效率、实时性,同时需要高吞吐量的总线上应用比较,比如DDR总线、GDDR总线、HDMI总线、Intel公司CPU互连的QPI/UPI总线等。 数字信号处理系统设计流程;新疆数字信号测试HDMI测试

新疆数字信号测试HDMI测试,数字信号测试

由于真正的预加重电路在实现时需要有相应的放大电路来增加跳变比特的幅度,电路  比较复杂而且增加系统功耗,所以在实际应用时更多采用去加重的方式。去加重技术不是  增大跳变比特的幅度,而是减小非跳变比特的幅度,从而得到和预加重类似的信号波形。 图 1.29是对一个10Gbps的信号进行-3.5dB的去加重后对频谱的影响。可以看到,去加  重主要是通过压缩信号的直流和低频分量(长0 或者长 1  的比特流),从而改善其在传输过  程中可 能造成的对短0或者短1 比特的影响。新疆数字信号测试HDMI测试数字信号的波形分析(Waveform Analysis);

新疆数字信号测试HDMI测试,数字信号测试

数据经过8b/10b编码后有以下优点:

(1)有足够多的跳变沿,可以从数据中进行时钟恢复。正常传输的数据中可能会有比较长的连续的0或者连续的1,而进行完8b/10b编码后,其编码规则保证了编码后的数据流中不会出现超过5个连续的0或1,信号中会出现足够多的跳变沿,因此可以采用嵌入式的时钟方式,即接收端可以从数据流中通过PLL电路直接恢复时钟,不需要专门的时钟传输通道。

(2)直流平衡,可以采用AC耦合方式。经过编码后数据中不会出现连续的0或者1, 但还是有可能在某个时间段内0或者1的数量偏多一些。从上面的编码表中我们可以看 到,同一个Byte对应有正、负两组10bit的编码, 一个编码中1的数量多一些,另一个编码中 0 的数量多一些。数据在对当前的Byte进行8b/10b编码传输时,会根据前面历史传输的 数据中正负bit的数量来选择使用哪一组编码,从而可以保证总线上正负bit的数量在任何 时刻基本都是平衡的,也就是直流点不会发生大的变化。直流点平衡以后,在信号传输的路 径上我们就可以采用AC耦合方式(常用的方法是在发送端或接收端串接隔直电容),这  样信号对于收发端的地电平变化和共模噪声的抵抗能力进一步增强,可以传输更远的距离。

采用串行总线以后,就单根线来说,由于上面要传输原来多根线传输的数据,所以其工作速率一般要比相应的并行总线高很多。比如以前计算机上的扩展槽上使用的PCI总线采用并行32位的数据线,每根数据线上的数据传输速率是33Mbps,演变到PCle(PCI-express)的串行版本后每根线上的数据速率至少是2.5Gbps(PCIel.0代标准),现在PCIe的数据速率已经达到了16Gbps(PCIe4.0代标准)或32Gbps(PCIe5.0代标准)。采用串行总线的另一个好处是在提高数据传输速率的同时节省了布线空间,芯片的功耗也降低了,所以在现代的电子设备中,当需要进行高速数据传输时,使用串行总线的越来越多。

数据速率提高以后,对于阻抗匹配、线路损耗和抖动的要求就更高,稍不注意就很容易产生信号质量的问题。图1.10是一个典型的1Gbps的信号从发送端经过芯片封装、PCB、连接器、背板传输到接收端的信号路径,可以看到在发送端的接近理想的0、1跳变的数字信号到达接收端后由于高频损耗、反射等的影响,信号波形已经变得非常恶劣,所以串行总线的设计对于数字电路工程师来说是一个很大的挑战。 高速数字接口原理与测试;

新疆数字信号测试HDMI测试,数字信号测试

伪随机码型(PRBS)

在进行数字接口的测试时,有时会用到一些特定的测试码型。比如我们在进行信号质量测试时,如果被测件发送的只是一些规律跳变的码型,可能不了真实通信时的恶劣情况,所以测试时我们会希望被测件发出的数据尽可能地随机以恶劣的情况。同时,因为这种数据流很多时候只是为了测试使用的,用户的被测件在正常工作时还是要根据特定的协议发送真实的数据流,因此产生这种随机数据码流的电路比较好尽可能简单,不要额外占用太多的硬件资源。那么怎么用简单的方法产生尽可能随机一些的数据流输出呢?首先,因为真正随机的码流是很难用简单的电路实现的,所以我们只需要生成尽可能随机的码流就可以了,其中常用的一种数据码流是PRBS(PseudoRandomBinarySequence,伪随机码)码流。PRBS码的产生非常简单,图1.21是PRBS7的产生原理,只需要用到7个移位寄存器和简单的异或门就可以实现。 真实的数字信号频谱;湖南数字信号测试市场价价格走势

抖动是数字信号,特别是高速数字信号重要的一个概念,越是高速的信号,其比特周期越短对于抖动要求就严格;新疆数字信号测试HDMI测试

这种并/串转换方法由于不涉及信号的编解码,结构简单,效率较高,但是需要收发端进行精确的时钟同步以控制信号的复用和解复用操作,因此需要专门的时钟传输通道,而且串行信号上一旦出现比较大的抖动就会造成串/并转换的错误。

因此,这种简单的并/串转换方式一般用于比较关注传输效率的芯片间的短距离互连或者一些光端机信号的传输中。另外,由于信号没有经过任何编码,信号中可能会出现比较长的连续的0或者连续的1,因此信号必须采用直流耦合方式,收发端一旦存在比较大的共模或地噪声,会严重影响信号质量,因此这种并/串转换方式用于电信号传输时或者传输速率不太高(通常<1Gbps),或者传输距离不太远(通常<50cm)的场合。 新疆数字信号测试HDMI测试

与数字信号测试相关的文章
山西自动化数字信号测试 2024-07-26

建立时间和保持时间加起来的时间称为建立/保持时间窗口,是接收端对于信号保持在 同一个逻辑状态的**小的时间要求。数字信号的比特宽度如果窄于这个时间窗口就肯定无 法同时满足建立时间和保持时间的要求,所以接收端对于建立/保持时间窗口大小的要求实 际上决定了这个电路能够工作的比较高的数据速率。通常工 作速率高一些的芯片,很短的建 立时间、保持时间就可以保证电路可靠工作,而工作速率低一 些的芯片则会要求比较长的建 立时间和保持时间。 另外要注意的是, 一个数字电路能够可靠工作的比较高数据速率不仅取决于接收端对于 建立/保持时间的要求,输出端的上升时间过缓、输出幅度偏小、信号和时钟中有抖动、信...

与数字信号测试相关的问题
信息来源于互联网 本站不为信息真实性负责